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講座の情報については、掲載時から内容に変更がある場合があります。また、募集期間内でも募集を終了している場合がありますので、詳しくは、詳細画面に記載の問い合わせ先へご確認ください。
「講座・研修」詳細
講座
研修
- 講座名
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HDLによるLSI開発技術（Verilog-HDL Vivado 開発編）＜FPGA開発シリーズ０＞
- 開催期間
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2024/05/15〜2024/05/16
- 開催日数
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3日
- 募集期間
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2024/03/01〜2024/05/01
- 開催場所
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高度ポリテクセンター 千葉市美浜区若葉3-1-2
- 受講料
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22,000円
- 対象者
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Verilog-HDLによるFPGA開発担当者
- 定員
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14名
内容
回路設計ツールの操作はかなり複雑です。実際にHDLで回路を設計するにあたっては、まず回路設計ツールを問題なく扱えることが重要となります。本コースでは、シンプルな組み合わせ回路と順序回路を製作するために必要な回路設計ツールの操作方法とVerilog-HDLの文法事項を学習します。
詳細はお問い合わせください
問い合わせ先
高度ポリテクセンター
- 電話番号
043-296-2582
- FAX番号
043-296-2585
kodo-poly02@jeed.go.jp
- 講座・研修
カテゴリー -
デジタル、ものづくり（電気・電子）
ID：95617
