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講座の情報については、掲載時から内容に変更がある場合があります。また、募集期間内でも募集を終了している場合がありますので、詳しくは、詳細画面に記載の問い合わせ先へご確認ください。
「講座・研修」詳細
講座
研修
- 講座名
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HDLによる実用回路設計手法〈FPGA開発シリーズ４〉
- 開催期間
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2024/09/25〜2024/09/27
- 開催日数
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3日
- 募集期間
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2024/03/01〜2024/09/11
- 開催場所
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高度ポリテクセンター 千葉市美浜区若葉3-1-2
- 受講料
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29,500円
- 対象者
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HDLによるFPGA/PLD開発担当者
- 定員
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14名
内容
「HDLによるLSI開発技術」の続編コースです。基本的なHDL記述ができる方を対象に、FPGAの開発に必要な様々なエッセンスを含む演習を通して、より実践的な設計手法を習得することができます。
詳細はお問い合わせください
問い合わせ先
高度ポリテクセンター
- 電話番号
043-296-2582
- FAX番号
043-296-2585
kodo-poly02@jeed.go.jp
- 講座・研修
カテゴリー -
ものづくり（電気・電子）、ものづくり（機械設計・開発・製図）
ID：99382
